A 3.6-GHz Type-II Sampling PLL With a Differential Parallel-Series Double-Edge S-PD Scoring 43.1-fsRMSJitter, −258.7-dB FOM, and −75.17-dBc Reference Spur

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标题	A 3.6-GHz Type-II Sampling PLL With a Differential Parallel-Series Double-Edge S-PD Scoring 43.1-fsRMSJitter, −258.7-dB FOM, and −75.17-dBc Reference Spur 3.6 GHz II型采样PLL，具有差分并联-串联双沿S-PD得分43.1-fsRMSJitter、−258.7 dB FOM和−75.17 dBc参考杂散相关领域 dBc公司抖动锁相环相位噪声压控振荡器 CMOS芯片功勋物理采样（信号处理）电子工程拓扑（电路）电气工程探测器数学算法工程类电压光电子学
网址	https://doi.org/10.1109/tvlsi.2022.3229342
DOI	10.1109/tvlsi.2022.3229342 doi
其它	期刊：IEEE Transactions on Very Large Scale Integration (VLSI) Systems 作者：Yunbo Huang; Yong Chen; Bo Zhao; Pui‐In Mak; Rui P. Martins 出版日期：2022-12-23
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