FPGA implementation of high performance digital FIR filter design using a hybrid adder and multiplier

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标题	FPGA implementation of high performance digital FIR filter design using a hybrid adder and multiplier 相关领域加法器乘数（经济学）现场可编程门阵列有限冲激响应计算机科学电子工程数字滤波器滤波器（信号处理）计算机体系结构计算机硬件算术数学工程类 CMOS芯片经济宏观经济学计算机视觉
网址	https://doi.org/10.1080/00207217.2022.2098387
DOI	10.1080/00207217.2022.2098387 doi
其它	期刊：International Journal of Electronics 作者：V. Thamizharasan; N. Kasthuri 出版日期：2022-07-05
求助人	ww 在 2023-05-30 01:52:05 发布自山东，悬赏 30 积分
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