A 0.039um<sup>2</sup> high performance eDRAM cell based on 32nm High-K/Metal SOI technology

绝缘体上的硅 材料科学 光电子学 化学
作者
Nauman Zafar Butt,K. McStay,Alberto Cestero,H. Ho,Weiran Kong,S. Fang,R. Krishnan,B. Khan,A. Tessier,William A. Davies,S. Lee,Y. Zhang,J. Johnson,S. Rombawa,R. Takalkar,Alisa Blauberg,Katherine V. Hawkins,J. Liu,Sami Rosenblatt,Puneet Goyal,Shanti S. Gupta,Joseph Ervin,Zewen Li,S. Galis,J. Barth,Minghui Yin,Todd Weaver,J. H. Li,S. Narasimha,P. Parries,W.K. Henson,Norman Robson,T. Kirihata,M. Chudzik,E. Maciejewski,P. Agnello,S. R. Stiffler,Subramanian S. Iyer
出处
期刊:International Electron Devices Meeting 被引量:15
标识
DOI:10.1109/iedm.2010.5703434
摘要

We present industry's smallest eDRAM cell and the densest embedded memory integrated into the highest performance 32nm High-K Metal Gate (HKMG) SOI based logic technology. The cell is aggressively scaled at 58% (vs. 45nm) and features the key innovation of High-K Metal (HK/M) stack in the Deep Trench (DT) capacitor. This has enabled 25% higher capacitance and 70% lower resistance compared to conventional SiON/Poly stack at matched leakage and reliability. The HKMG access transistor developed in high performance optimized technology features sub 3fA leakage and well-controlled threshold voltage sigma of 40mV. The fully integrated 32Mb product prototypes demonstrate state of the art performance with excellent retention and yield characteristics. The sub 1.5ns latency and 2ns cycle time have been verified with preliminary testing whereas even better performance is expected with further characterization. In addition, the trench capacitors set the industry benchmark for the most efficient decoupling in any 32nm technology.
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