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 Three-dimensional transistors with two-dimensional semiconductors for future CMOS scaling 用于未来CMOS缩放的具有二维半导体的三维晶体管
相关领域
CMOS芯片
缩放比例
半导体
晶体管
材料科学
光电子学
电子工程
电气工程
工程类
数学
电压
几何学
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求正式发表版本
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| 其它 |
期刊：Nature electronics 作者：Arnab Pal; Tanmay Chavan; Joey M. Jabbour; Wei Cao; Kaustav Banerjee 出版日期：2024-12-16 |
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