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标题
A Multi-Stage CTLE Design and Optimization for PCI Express Gen6.0 Link Equalization
PCI Express Gen6.0链路均衡的多级CTLE设计与优化
相关领域
PCI Express 抖动 电子工程 计算机科学 带宽（计算） 有限冲激响应 发射机 误码率 背板 均衡（音频） 频道（广播） 工程类 计算机硬件 电信 现场可编程门阵列
网址
https://doi.org/10.1109/laedc58183.2023.10209113
AI链接 handle.net iteso.mxdoi.org
DOI
10.1109/laedc58183.2023.10209113 doi
其它 期刊：
作者：Karla G. López-Araiza; Francisco E. Rangel-Patiño; Jorge E. Ascencio-Blancarte; Edgar A. Vega-Ochoa; José E. Rayas‐Sánchez; et al
出版日期：2023-07-03
求助人
猎模人战忽官 在 2025-04-25 01:31:19 发布自上海，悬赏 10 积分
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