A Low-Spur and Low-Jitter Fractional-$N$ Digital PLL Based on an Inverse-Constant-Slope DTC and FCW Subtractive Dithering

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标题	A Low-Spur and Low-Jitter Fractional-$N$ Digital PLL Based on an Inverse-Constant-Slope DTC and FCW Subtractive Dithering 基于逆恒斜率直接转矩和FCW减法抖动的低杂散低抖动分数阶数字锁相环相关领域抖动抖动 CMOS芯片线性数学反向锁相环三角积分调变算法电子工程计算机科学物理带宽（计算）工程类电信几何学
网址	https://doi.org/10.1109/jssc.2023.3311681
DOI	10.1109/jssc.2023.3311681 doi
其它	期刊：IEEE Journal of Solid-state Circuits 作者：Simone M. Dartizio; Francesco Tesolin; Giacomo Castoro; Francesco Buccoleri; Michele Rossoni; et al 出版日期：2023-12-01
求助人	木木三在 2024-09-09 15:45:56 发布自四川，悬赏 10 积分
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