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 A 5-bit High-Linearity, Binary-Recombination-Redundancy Sub-SAR ADC in 300MS/s, 14-bit Pipelined-SAR ADC 一种300MS/s的5位高线性、二进制重组冗余次SAR ADC，14位流水线SAR ADC
相关领域
逐次逼近ADC
有效位数
冗余（工程）
计算机科学
电子工程
二进制数
电容器
线性
电气工程
工程类
数学
算术
CMOS芯片
电压
操作系统
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| 其它 |
期刊： 作者：Fuller W. Bazer; Ziwei Li; Yutong Zhao; Fan Ye; Junyan Ren 出版日期：2021-10-26 |
| 求助人 | |
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