Low power D-latch design using MCML tri-state buffers

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标题	Low power D-latch design using MCML tri-state buffers 基于MCML三态缓冲器的低功耗D锁存器设计相关领域功率（物理） CMOS芯片国家（计算机科学）电子工程低功耗电子学功率消耗电气工程计算机科学工程类物理算法量子力学
网址	https://doi.org/10.1109/spin.2014.6777011
DOI	10.1109/spin.2014.6777011 doi
其它	期刊：作者：Radhika; Neeta Pandey; Kirti Gupta; Maneesha Gupta 出版日期：2014-02-01
求助人	11zys 在 2024-09-19 17:37:40 发布自福建，悬赏 10 积分
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