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 A 1 μs Locking Time Dual Loop ADPLL with Foreground Calibration-Based 6 ps Resolution Flash TDC in 180 nm CMOS 180 nm CMOS中具有基于前景校准的6 ps分辨率Flash TDC的1 μ s锁定时间双环ADPLL
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期刊：Circuits Systems and Signal Processing 作者：Jagdeep Kaur Sahani; Anil Singh; Alpana Agarwal 出版日期：2021-11-10 |
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