A 1 μs Locking Time Dual Loop ADPLL with Foreground Calibration-Based 6 ps Resolution Flash TDC in 180 nm CMOS

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标题	A 1 μs Locking Time Dual Loop ADPLL with Foreground Calibration-Based 6 ps Resolution Flash TDC in 180 nm CMOS 180 nm CMOS中具有基于前景校准的6 ps分辨率Flash TDC的1 μ s锁定时间双环ADPLL 相关领域抖动锁相环 CMOS芯片 dBc公司时间数字转换器数控振荡器相位噪声闪光灯（摄影）电子工程偏移量（计算机科学）计算机科学物理工程类光学时钟信号变频振荡器程序设计语言
网址	https://doi.org/10.1007/s00034-021-01861-z
DOI	10.1007/s00034-021-01861-z doi
其它	期刊：Circuits Systems and Signal Processing 作者：Jagdeep Kaur Sahani; Anil Singh; Alpana Agarwal 出版日期：2021-11-10
求助人	lbt1686666 在 2024-08-28 22:16:07 发布自浙江，悬赏 10 积分
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